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Internet Message Format  |  1996-03-16  |  3KB
  1. From: Tibor_Pausz@p15.f160.n2455.z2.fido.sub.org (Tibor Pausz)
  2. Organization: 
  3. Path: f160.n2455.z2.fidonet.org!not-for-mail
  4. Newsgroups: fido.ger.amiga
  5. Subject: Penitum = RISC mit 486-Emulator?
  6. Message-ID: <MSGID_2=3A2455=2F160.15_28c00015@fidonet.org>
  7. References: <MSGID_2=3A246=2F1416.60=40Fidonet_3F9871E8@fidonet.org>
  8. Date: Wed, 06 Sep 1995 10:30:24 +0200
  9.  
  10. In a message dated 11 Aug 95  Andreas Joos wrote to Christian Roethlisberge:
  11.  > Du schriebst:
  12.  
  13. DE> So wie bei: Hardware: Siehe Intel? Die wollen keinen wirklich neuen 
  14. DE> Prozessor heraus- bringen, weil er nicht mehr kompatibel waere!
  15.  
  16. CR> Dazu kann ich sagen, dass der Pentium ein RISC-Proz ist (also voellig 
  17. CR> andere architektur). Er hat jedoch eine eingebaute 486-Emulation dass
  18. CR> er noch kompatibel ist. Es waere also an den Softwareschmieden, reine 
  19. CR> Pentium-Soft zu schreiben und dies wird frueher oder spaeter
  20. CR> passieren. Von der Idee her gar nicht so bloed.
  21.  
  22.  > Hmmm.. wie ist denn das schon wieder zu verstehen? Dass er, wie ein
  23.  > Basic-Interpreter die Befehle interpretiert und dann in dem
  24.  > eigentlichen Pentium-Befehlssatz abarbeitet? Also daran kann ich nicht 
  25.  > glauben...
  26.  
  27.  > Hat der Pentium denn einen 2. Befehlssatz, der vom 486-Befehlssatz
  28.  > abweicht?
  29. Nein den gibts in diesem Sinne nicht, ausser den anderen Modi in denen er laufen
  30. kann. Der Pentium ist auch noch nicht 100% RISC das wird erst der P6. Aber bei
  31. beiden kann man den "echten" RISC-Code nicht direkt erreichen. Es muss 486 Code
  32. verwendet werden (noch nicht mal den verwenden die Hersteller).
  33.  
  34.  > Oder hat er nur einen Teil des Befehlssatzes des 486 als Hardware 
  35.  > implementiert, und den Rest arbeitet er per Software ab, wie z.B. die 
  36.  > FPU im 68040? Hab ich bisher auch noch nie was davon gehoert...
  37.  
  38. Es gibt massig Microcode im Pentium und noch viel mehr im P6. Der P6 wird fast
  39. alles aus Microcodebefehlen haben. Um das Pipelinin bei diesen Chips
  40. einigermassen effektiv zu gestellten muss die Pipetiefe sehr hoch sein 10-12
  41. wohingegen ein reiner RISC mit 6-8 laeuft.
  42.  
  43.  > Also nur weil 1-2 Befehle fallen gelassen wurden, wuerd ich eine CPU
  44.  > noch lange nicht als RISC-Prozessor bezeichnen...
  45.  
  46. An diesem Gesichtspunkt kann man heute einen RISC eh nicht mehr fest machen.
  47. Viel wichtiger ist das Pipelining, das bei einem P6 ungefaehr bis Stufe 12 geht.
  48. Wehe wenn da ein Cachemiss auftritt, das heisst Cache leeren, das ganze
  49. Pipelining war umsonst etc.
  50.  
  51.  > Und wenn er den 486er hardwaremaessig emuliert, dann ist es in meinen
  52.  > Augen schon 2* kein RISC, sondern ein CISC...
  53.  
  54. Doch doch es bleibt RISC, denn der Befehlssatz ist nicht das wichtigste am
  55. RISC.
  56.  
  57.  > Gryf ap Llandrysgryf
  58.  
  59.  > === Lieber ARM drin, als Arm ab --- FidoMail v.1.96h (25 Sep 1994)  *
  60.  > Origin: Ich bin zu erreichen unter: (2:246/1416.60)
  61. Ciao,
  62.   Tibor
  63.